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Fecha de publicaciónTítuloAutor(es)
1991Diseño de un analizador lógico de 16 canales basado en un MicroprocesadorSoto Hoyos, Jorge; Morales Villanueva, Aurelio Federico
1-dic-2007Diseño e implementación de una red neuronal en un FPGA para recuperación de patronesMorales Villanueva, Aurelio Federico; Briceño Aranda, César Alberto; amorales@uni.edu.pe
1-dic-2002Incremento de la capacidad de un sistema celular jerárquico CDMA por la asignación a celdas basada en la movilidad de los usuariosMorales Villanueva, Aurelio Federico; Tagle C, Fernando; ftaglec@ec-red.com
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